PARSER DE RTL Verilog. analisador de verilog baseado em java
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PARSER DE RTL Verilog. Classificação e resumo

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PARSER DE RTL Verilog. Descrição

VerilogParser é um analisador simples, acessível e prático que foi desenvolvido para aqueles que querem projetar sua própria utilidade em torno do Verilog RTL. Este analisador foi desenvolvido em Java, a fim de tornar a plataforma independente. Ele lê o RTL e preenche suas estruturas internas de dados. Há APIs para extrair as informações de design do banco de dados, há APIs para elaborar cada elemento de design junto com as capacidades de avaliação de expressão.

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