verilog2vhdl. Free Verilog para VHDL Converter
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verilog2vhdl. Classificação e resumo

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conversor Verilog. VHDL

verilog2vhdl. Descrição

Verilog2VHDL é um utilitário que foi desenvolvido para aqueles que querem converter um design de verilog existente em VHDL. O VHDL gerado pode não funcionar como é e pode exigir alguma correção manual para garantir a correspondência do tipo de dados do VHDL. Isso foi desenvolvido em Java (1.6.x), a fim de tornar a plataforma independente e empacotada como um arquivo jar executável. Clique aqui para baixar este tradutor grátis para plataforma Linux e clique aqui para baixá-lo para Windows.usage: verilog2vhdl -in simple_and.v -top simple_and_top -out simple_and.vhdorjava -jar $ Edautils_root / lib / verilog2vhdl.jar -in simpl_and.v -Top simple_and -out output.vhdtere são outros switches como -only_entity para criar apenas a entidade que corresponde à parte superior especificada. Da mesma forma, há -only_component para criar uma declaração de componente correspondente à página inicial do módulo especificado.

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