Hardware :: VHDL :: Parser Uma gramática completa para analisar o código VHDL usando Perl
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Hardware :: VHDL :: Parser Classificação e resumo

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Módulo Perl. perl analisador VHDL Analisador VHDL.

Hardware :: VHDL :: Parser Descrição

Uma gramática completa para analisar o código VHDL usando Perl Hardware :: VHDL :: Parser é um módulo Perl que define a gramática completa necessária para analisar qualquer código VHDL. Ao sobrecarregar esta gramática, é possível criar scripts Perl que executam através do código VHDL e execute funções específicas. Por exemplo, um hierarchy.pm usa hardware :: VHDL :: Parser para sobrecarregar a regra de gramática para instanciações de componentes. Essa única modificação imprimirá todos os nomes de instâncias que ocorrem no arquivo sendo analisados. Isso pode ser útil para criar um script de compilação automática ou um navegador hierárquico gráfico de um design VHDL.Este módulo está atualmente em versão beta. Todo o código está sujeito a alterações. Relatórios de Bug são bem-vindos.Synopsis Use hardware :: VHDL :: Parser; $ parser = novo hardware :: vhdl :: analisador; $ parser-> nome de arquivo (@Argv); Requisitos: · Perl.

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