Xilinx planahead. Programa de solução de design de array de porta programável de campo para desenvolvedores de dispositivos.
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Xilinx planahead. Classificação e resumo

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Xilinx planahead. Descrição

Se você estiver procurando por uma solução para evitar a corrupção da operação de dispositivos conduzidos pela FPGA e deseja limitar a quantidade de rejeição do solo presente na saída, o recurso de integridade do sinal de análise do design Xilinx PlanaHead 10.1 pode ser apenas o que Você precisa, uma vez que fornece uma função para verificar os limites para a análise da base. O programa também inclui a tecnologia PinaHead dentro de seu ambiente para atribuição de portas de E / S que você pode importar de formatos de arquivo CSV para atribuir aos pinos de pacote físico para definir a configuração dos pinos do dispositivo. Os formatos de arquivo VHDL ou Verilog contendo portas também podem ser importados para preencher as portas de E / S. Para fornecer uma solução de design rápida e eficiente, você também pode usar o software para criar restrições de planejamento de piso, implementar seus projetos com o software Xilinx ISE e software de roteamento, exportar arquivos para implementação externa do ISE e importar os resultados de volta para o PlanAhead. O programa também possui criação de IP e exportação de Pblocks para implementação, bem como importação de RTL e elaboração sem executar sínteses e isso inclui um editor HDL com crossprobing, estimativa de recursos para design e módulos. Usando o PlanAhead para seus projetos FPGA é fácil com sua interface multivitada, onde você pode exibir janelas necessárias para trabalhar, como sua janela de exibição de plantas, visualizar visualização, visualização de console, visualização do RTL Netlist e sua janela de exibição do espaço de trabalho. Luis Sanchez. Avaliação do Editor:

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